星海爭霸21全功能兌換碼新手獎勵1、7小時遊戲時間（14天內）解除所有試玩版本限制直到7小時耗盡，如種族、匹配模式、戰役、地圖等詳細資訊(150119更新)4505624695013984483730049
2020-11-30 03:45:43
cadence如何生成網表
2019-12-15 18:21:59
Cadence如何生成網表的詳細教學
1
1、生成網表之前，首先要檢查原理圖的邏輯功能是否正確；各個部分的電氣連線是否正確，對整個工程的所有元件重新進行索引編號。 選中工程管理器中的DSN檔案------選單欄，Tools------Annotate。
2
對所有元件進行編號，確保沒有遺漏。否則生成網表失敗。
3
雙擊元件設定pcb封裝屬性，並對整個原理圖所有元件設定pcb Footprint屬性。
4
對整個工程進行DRC檢查。選中工程管理器中的DSN檔案------選單欄，Tools------Design Rules Check。並檢視是否有錯誤發生，如果對話方塊資訊沒有error，說明 DRC檢查通過了。
5
生成網路表， 選中工程管理器中的DSN檔案------選單欄，Tools------Create Netlist。網表會自動生成到本工程資料夾下面的allegro資料夾裡面。
6
開啟allegro資料夾，其中netlist.log檔案是生成記錄紀錄檔，裡面有生成及錯誤資訊。最好用專用文書處理軟體開啟，或者簡單的Notepad++軟體開啟檢視。
7
其中：#1 WARNING(ORCAP-36006): Part Name "HEADER 17X2_CON254MM2X17_HEADER 17X2" is renamed to "HEADER......"是因為元件命名過長導致，可忽略。至此，生成網表成功！相關文章
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